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반도체 회로대학원 컨택

2024.06.28

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722

안녕하십니까 건동홍 라인 전전에 재학중인 3학년 학부생입니다. 이번 학기에 성적이 나쁘게 나와 총 gpa가 4.0/4.5입니다. 반도체 회로 설계쪽이 to가 많이 나지 않는다고 들었습니다..ㅠ 저희 학교만 봐도 자대 과탑들만 들어가고 있구요..
어렵다고 해서 시도를 하지 않을 것은 아니지만 어떤 활동을 통해 제가 랩실에 어필할 수 있을 부분을 만들 수 있을지 궁금합니다.
그리고 보통 대학원 랩실은 언제 컨택하는지 궁금합니다..
바쁘시겠지만 회로설계쪽 선배님들 의견을 여쭈어보고 싶습니다..ㅠㅠ

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댓글 6개

2024.06.28

회로이론,전자회로 성적, 설계한 프로젝트들 내용 정리, 졸작으로 만든 회로 정도가 어필될 수 있을 것 같아요

대댓글 3개

2024.06.28

좋은 의견 감사합니다.. 혹시 회로설계 랩실쪽 분이시라면 요즘 회로설계분야에서 타대생을 뽑는 경우가 있긴 한가요..??

2024.06.28

저희 연구실은 올해는 이미 진학 예정인 학부연구생이 to를 다 채워서 없을 것 같아요 다른 연구실은 잘 모르겠는데 비슷한 회로 하시는 옆 연구실도 이미 선발 됐다고 들었습니다

2024.06.29

혹시 학교가 어느라인이신지 여쭈어봐도 될까요..??

2024.06.28

DGIST UNIST GIST 이런데들이 자대 학부생 수 자체가 너무 적어서 타대생 많이 뽑는다고 알고 있음

대댓글 1개

2024.06.28

감사합니다..ㅠㅠ 이번에 꼭 연구인턴 지원해 봐야겠네요!!

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